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在船上,在生活中,时间就是一切(几乎)| PCB跟踪长度——住在甜点

它是一个古老的谚语。(不是所有旧谚语的定义?)这次测试的建议并不意味着信号完整性的人群,但它是有意义的:时间就是一切。你的电路的设计是为了让事情发生在正确的顺序。真的是他们工作的唯一途径,是的,没有多少人有机会问题如果我们以外的时间预算。

我们很幸运,有技术,帮助我们管理时间限制。X-nets、pin-pairs和匹配组乍看起来有点吓人。一旦掌握,这是很棒的工具捕捉、执行和验证最复杂的设计。

一次一点

长度匹配始于两个在数字域。有时,两个痕迹是互补彼此的镜像。接收销对两个信号的比较,决定的状态函数——一个逻辑1(一)或0(零)。从积极和消极痕迹感觉的痛苦有了相同的基本路径,标准的噪音,他们捡起消掉了。比较器是坐在那里远端和等待一个电话。这它的东西,我们只剩下两间的电压差作为官方的逻辑状态。

这些微分对有一些最严格的时间参数。你想要这两块信息接收者在同一瞬间。长度匹配是+ / -几英寸。有时,这仍然是不够的。假设,一个波形需要内部线和其对应的前面。然后擦肩而过的小开关模式电源去热一下。当第二个波形支安打,拿起噪音,没有一个毫秒前。所以,我们有我们所说的动态相宽容。这是我们弥补对每一次通过重新排列两个痕迹一个小肿块,较短的路线。静态相宽容是当我们考虑整个长度和司机针附近的补偿。

除此之外,我们diff-pairs有两种口味,紧密耦合和松散耦合。紧密耦合线发生在两者之间的气隙是一样的痕迹比线宽或更少。松散耦合的线可以有两个,三个,甚至四倍的痕迹宽度的差距。这更多的与阻抗和干扰抑制比实际长度,但是请注意,松散耦合线将会得到进一步的阶段,因为夸张的捷径。好消息是,我们可以有更多和更广泛的非耦合长度间距。那些小phase-tuning疙瘩加起来。

最常见的协议利用微分对。包括PCI, USB, MIPI(相机)以及一些老式的模拟应用程序。也许你已经看到了一个放大器的平衡和不平衡输出。平衡输出微分,在嘈杂的环境中工作的能力而闻名,不再运行。


一些音频设备平衡和不平衡的I / O

前进了一步

我们都看到了“意大利面条”蛇形蜿蜒的痕迹从SOC记忆体晶片(年代)。你们中的一些人甚至可能引发当艺术家试图描绘一个合适的电路板。你并不孤单。呵!可以预见的是,数据速率和带宽取决于每一个新的一代。那么长度要求变得更加严格。

新闻快报

经验法则是,当有更少的数据通道,每一个都是携带更多的数据和需要更多的照顾。闪存SPI之类的协议,UFS和EMMC序列化数据较少的线路。你有关于四双,时钟和复位。我们比赛对自己第一次和紧密。然后,对相互匹配随着时钟的名义长度的目标。一系列的严格要求是嵌套在一个总体预算,有点宽松。

DDR内存

这一主题展开另一种类型的记忆;随机存取或RAM。DDR的速记数据速率的两倍。在实践中这意味着什么是我们审问时设备时钟波动从0到1时又回到零的持续振荡。(公平地说这个话题需要约10000字)。

所有的系统是要告诉你的是,时钟的相位与自身而太长和太短……

我们把痕迹的一条河分成组。通常,每组有八个成员的地址和数据行。这些是护送通过各种控制、命令和时钟线,骑在上面的地址和数据组。八组的数量取决于数量的内存,但指望每个每个内存芯片的四条车道。这些8位“字节”车道级联序列中注册它们的价值,需要良好的控制时间。从集团到集团,有更多的自由。

总长度的目标是由时钟本身就是一对差动对于这个应用程序。所以你可以路由的所有连接,然后开始滑动时钟对发现不正确的长度之间的积极的和消极的痕迹。此外,一些相关的个别成员的字节车道可能太短,需要蛇形。然后,有异常跟踪,去遥远的角落的记忆装置,它为当前时钟长度太长

所有的系统是要告诉你的是,时钟的阶段与本身而太长和太短一切。你要想要约束管理器打开第二个屏幕,如果可能的话。分析数据将揭示它的长短更高效的不仅仅是摇摇欲坠的命令。

智慧大师(小g)时间:

寻找最长的组的成员,看看你能不能减少一些角落让它短。注意右边的“用橡皮筋”痕迹的屏幕截图所示。你可能会这样做,所有的痕迹都超过时钟。如果解决了在长边长度错误,看看你是否能缩短时钟到之前就太短,以满足面具。另一方面,如果时钟仍然不够长,添加一些蛇形,直到比赛的长度最长的线-允许公差。这些东西不需要相同的长度。使用可用的污水减少自然短的蛇形线。这是最优雅的解决方案。

时间限制为数字电路设置栏相同程度的阻抗驱动器模拟世界。我们仍然希望避免在我们高速电路阻抗不匹配。不要在相邻的平面层缺口。噢,是的,平面层和缝合通过。这些路线length-matched痕迹尽快在设计周期。你会想知道你是否有足够的层每件东西都保持整洁。使用低成本的层叠的建设可以把你放在GND-SIG-SIG-GND配置。你要小心不要造成侧向信号层之间的耦合。

有些痕迹宽度控制,只需要保持尽可能的短。其他模拟作为延时线痕迹和漫步。然后,有数字痕迹成对约束和重叠组不同大小的不同需求。管理所有这些可以手工完成。如果是计划,我建议让那些手腕括号不可避免腕管的问题。从长远来看,电子表格的知识管理规则将是一个更好的设计命题。这不是一个新的谚语。时间就是一切!


关于作者

小约翰·Burkhert职业PCB设计经验在军事、电信、消费者硬件和最近,汽车工业。最初,射频专家——现在不得不抛一点然后填补高速数字设计的必要性。约翰喜欢打低音和赛车自行车当他不写或执行PCB布局。你可以找到约翰在LinkedIn。

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